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armemu: Simplify SSAT/SSAT16/SXTB/SXTAB
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9f5b53f9ff
commit
6ce2a38ec4
@ -6272,84 +6272,61 @@ L_stm_s_takeabort:
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||||
return 1;
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}
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}
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printf("Unhandled v6 insn: pkh/sxtab/selsxtb\n");
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||||
break;
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case 0x6a: {
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ARMword Rm;
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int ror = -1;
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printf("Unhandled v6 insn: pkh/sxtab/selsxtb\n");
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||||
break;
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switch (BITS(4, 11)) {
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case 0x07:
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ror = 0;
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break;
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case 0x47:
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ror = 8;
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break;
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case 0x87:
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ror = 16;
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break;
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case 0xc7:
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ror = 24;
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break;
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case 0x6a: // SSAT, SSAT16, SXTB, and SXTAB
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{
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const u8 op2 = BITS(5, 7);
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case 0x01:
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case 0xf3:
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//ichfly
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//SSAT16
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{
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||||
const u8 rd_idx = BITS(12, 15);
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||||
const u8 rn_idx = BITS(0, 3);
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||||
const u8 num_bits = BITS(16, 19) + 1;
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||||
const s16 min = -(0x8000 >> (16 - num_bits));
|
||||
const s16 max = (0x7FFF >> (16 - num_bits));
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||||
s16 rn_lo = (state->Reg[rn_idx]);
|
||||
s16 rn_hi = (state->Reg[rn_idx] >> 16);
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||||
// SSAT16
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||||
if (op2 == 0x01) {
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||||
const u8 rd_idx = BITS(12, 15);
|
||||
const u8 rn_idx = BITS(0, 3);
|
||||
const u8 num_bits = BITS(16, 19) + 1;
|
||||
const s16 min = -(0x8000 >> (16 - num_bits));
|
||||
const s16 max = (0x7FFF >> (16 - num_bits));
|
||||
s16 rn_lo = (state->Reg[rn_idx]);
|
||||
s16 rn_hi = (state->Reg[rn_idx] >> 16);
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||||
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||||
if (rn_lo > max) {
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||||
rn_lo = max;
|
||||
SETQ;
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||||
} else if (rn_lo < min) {
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||||
rn_lo = min;
|
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SETQ;
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||||
}
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||||
|
||||
if (rn_hi > max) {
|
||||
rn_hi = max;
|
||||
SETQ;
|
||||
} else if (rn_hi < min) {
|
||||
rn_hi = min;
|
||||
SETQ;
|
||||
}
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||||
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||||
state->Reg[rd_idx] = (rn_lo & 0xFFFF) | ((rn_hi & 0xFFFF) << 16);
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||||
return 1;
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||||
if (rn_lo > max) {
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||||
rn_lo = max;
|
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SETQ;
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||||
} else if (rn_lo < min) {
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||||
rn_lo = min;
|
||||
SETQ;
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||||
}
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default:
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break;
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}
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if (ror == -1) {
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if (BITS(4, 6) == 0x7) {
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printf("Unhandled v6 insn: ssat\n");
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return 0;
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||||
if (rn_hi > max) {
|
||||
rn_hi = max;
|
||||
SETQ;
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||||
} else if (rn_hi < min) {
|
||||
rn_hi = min;
|
||||
SETQ;
|
||||
}
|
||||
break;
|
||||
|
||||
state->Reg[rd_idx] = (rn_lo & 0xFFFF) | ((rn_hi & 0xFFFF) << 16);
|
||||
return 1;
|
||||
}
|
||||
else if (op2 == 0x03) {
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||||
const u8 rotation = BITS(10, 11) * 8;
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||||
u32 rm = ((state->Reg[BITS(0, 3)] >> rotation) & 0xFF) | (((state->Reg[BITS(0, 3)] << (32 - rotation)) & 0xFF) & 0xFF);
|
||||
if (rm & 0x80)
|
||||
rm |= 0xffffff00;
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||||
|
||||
Rm = ((state->Reg[BITS(0, 3)] >> ror) & 0xFF) | (((state->Reg[BITS(0, 3)] << (32 - ror)) & 0xFF) & 0xFF);
|
||||
if (Rm & 0x80)
|
||||
Rm |= 0xffffff00;
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||||
// SXTB, otherwise SXTAB
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if (BITS(16, 19) == 0xf)
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state->Reg[BITS(12, 15)] = rm;
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else
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state->Reg[BITS(12, 15)] = state->Reg[BITS(16, 19)] + rm;
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||||
|
||||
if (BITS(16, 19) == 0xf)
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||||
/* SXTB */
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||||
state->Reg[BITS(12, 15)] = Rm;
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||||
else
|
||||
/* SXTAB */
|
||||
state->Reg[BITS(12, 15)] = state->Reg[BITS(16, 19)] + Rm;
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||||
|
||||
return 1;
|
||||
return 1;
|
||||
}
|
||||
else {
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printf("Unimplemented op: SSAT");
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||||
}
|
||||
}
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||||
break;
|
||||
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||||
case 0x6b: // REV, REV16, SXTH, and SXTAH
|
||||
{
|
||||
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