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armemu: Implement SADD8/SSUB8
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parent
0e9262885d
commit
855eda6f85
@ -5824,9 +5824,9 @@ L_stm_s_takeabort:
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case 0x3f:
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case 0x3f:
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printf ("Unhandled v6 insn: rbit\n");
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printf ("Unhandled v6 insn: rbit\n");
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break;
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break;
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case 0x61: // SSUB16, SADD16, SSAX, and SASX
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case 0x61: // SADD16, SASX, SSAX, and SSUB16
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if ((instr & 0xFF0) == 0xf70 || (instr & 0xFF0) == 0xf10 ||
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if ((instr & 0xFF0) == 0xf10 || (instr & 0xFF0) == 0xf30 ||
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||||||
(instr & 0xFF0) == 0xf50 || (instr & 0xFF0) == 0xf30)
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(instr & 0xFF0) == 0xf50 || (instr & 0xFF0) == 0xf70)
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{
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{
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const u8 rd_idx = BITS(12, 15);
|
const u8 rd_idx = BITS(12, 15);
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||||||
const u8 rm_idx = BITS(0, 3);
|
const u8 rm_idx = BITS(0, 3);
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||||||
@ -5839,25 +5839,25 @@ L_stm_s_takeabort:
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s32 lo_result;
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s32 lo_result;
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s32 hi_result;
|
s32 hi_result;
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// SSUB16
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if ((instr & 0xFF0) == 0xf70) {
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lo_result = (rn_lo - rm_lo);
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hi_result = (rn_hi - rm_hi);
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}
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// SADD16
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// SADD16
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else if ((instr & 0xFF0) == 0xf10) {
|
if ((instr & 0xFF0) == 0xf10) {
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lo_result = (rn_lo + rm_lo);
|
lo_result = (rn_lo + rm_lo);
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hi_result = (rn_hi + rm_hi);
|
hi_result = (rn_hi + rm_hi);
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}
|
}
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// SASX
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else if ((instr & 0xFF0) == 0xf30) {
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lo_result = (rn_lo - rm_hi);
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hi_result = (rn_hi + rm_lo);
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|
}
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// SSAX
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// SSAX
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else if ((instr & 0xFF0) == 0xf50) {
|
else if ((instr & 0xFF0) == 0xf50) {
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lo_result = (rn_lo + rm_hi);
|
lo_result = (rn_lo + rm_hi);
|
||||||
hi_result = (rn_hi - rm_lo);
|
hi_result = (rn_hi - rm_lo);
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||||||
}
|
}
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||||||
// SASX
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// SSUB16
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else {
|
else {
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lo_result = (rn_lo - rm_hi);
|
lo_result = (rn_lo - rm_lo);
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hi_result = (rn_hi + rm_lo);
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hi_result = (rn_hi - rm_hi);
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}
|
}
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state->Reg[rd_idx] = (lo_result & 0xFFFF) | ((hi_result & 0xFFFF) << 16);
|
state->Reg[rd_idx] = (lo_result & 0xFFFF) | ((hi_result & 0xFFFF) << 16);
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||||||
@ -5878,8 +5878,81 @@ L_stm_s_takeabort:
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state->Cpsr &= ~(1 << 19);
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state->Cpsr &= ~(1 << 19);
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}
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}
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return 1;
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return 1;
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} else {
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}
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printf("Unhandled v6 insn: %08x", BITS(20, 27));
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// SADD8/SSUB8
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else if ((instr & 0xFF0) == 0xf90 || (instr & 0xFF0) == 0xff0)
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{
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const u8 rd_idx = BITS(12, 15);
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|
const u8 rm_idx = BITS(0, 3);
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||||||
|
const u8 rn_idx = BITS(16, 19);
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const u32 rm_val = state->Reg[rm_idx];
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const u32 rn_val = state->Reg[rn_idx];
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u8 lo_val1;
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u8 lo_val2;
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u8 hi_val1;
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|
u8 hi_val2;
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// SADD8
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if ((instr & 0xFF0) == 0xf90) {
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lo_val1 = (u8)((rn_val & 0xFF) + (rm_val & 0xFF));
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||||||
|
lo_val2 = (u8)(((rn_val >> 8) & 0xFF) + ((rm_val >> 8) & 0xFF));
|
||||||
|
hi_val1 = (u8)(((rn_val >> 16) & 0xFF) + ((rm_val >> 16) & 0xFF));
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||||||
|
hi_val2 = (u8)(((rn_val >> 24) & 0xFF) + ((rm_val >> 24) & 0xFF));
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if (lo_val1 & 0x80)
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state->Cpsr |= (1 << 16);
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else
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state->Cpsr &= ~(1 << 16);
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|
if (lo_val2 & 0x80)
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|
state->Cpsr |= (1 << 17);
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|
else
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|
state->Cpsr &= ~(1 << 17);
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|
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if (hi_val1 & 0x80)
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|
state->Cpsr |= (1 << 18);
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|
else
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|
state->Cpsr &= ~(1 << 18);
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|
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||||||
|
if (hi_val2 & 0x80)
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||||||
|
state->Cpsr |= (1 << 19);
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|
else
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||||||
|
state->Cpsr &= ~(1 << 19);
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|
}
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|
// SSUB8
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else {
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|
lo_val1 = (u8)((rn_val & 0xFF) - (rm_val & 0xFF));
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|
lo_val2 = (u8)(((rn_val >> 8) & 0xFF) - ((rm_val >> 8) & 0xFF));
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||||||
|
hi_val1 = (u8)(((rn_val >> 16) & 0xFF) - ((rm_val >> 16) & 0xFF));
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||||||
|
hi_val2 = (u8)(((rn_val >> 24) & 0xFF) - ((rm_val >> 24) & 0xFF));
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||||||
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if (!(lo_val1 & 0x80))
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state->Cpsr |= (1 << 16);
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else
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state->Cpsr &= ~(1 << 16);
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if (!(lo_val2 & 0x80))
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state->Cpsr |= (1 << 17);
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|
else
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state->Cpsr &= ~(1 << 17);
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if (!(hi_val1 & 0x80))
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|
state->Cpsr |= (1 << 18);
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|
else
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|
state->Cpsr &= ~(1 << 18);
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if (!(hi_val2 & 0x80))
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|
state->Cpsr |= (1 << 19);
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|
else
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|
state->Cpsr &= ~(1 << 19);
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|
}
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||||||
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|
state->Reg[rd_idx] = (lo_val1 | lo_val2 << 8 | hi_val1 << 16 | hi_val2 << 24);
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|
return 1;
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|
}
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||||||
|
else {
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|
printf("Unhandled v6 insn: %08x", instr);
|
||||||
}
|
}
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||||||
break;
|
break;
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||||||
case 0x62: // QADD16, QASX, QSAX, and QSUB16
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case 0x62: // QADD16, QASX, QSAX, and QSUB16
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