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0530fd2499
@ -68,6 +68,67 @@ static void remove_exclusive(ARMul_State* state, ARMword addr){
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state->exclusive_tag = 0xFFFFFFFF;
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state->exclusive_tag = 0xFFFFFFFF;
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}
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}
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static int CondPassed(ARMul_State* cpu, unsigned int cond) {
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#define NFLAG cpu->NFlag
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#define ZFLAG cpu->ZFlag
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#define CFLAG cpu->CFlag
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#define VFLAG cpu->VFlag
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int temp = 0;
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switch (cond) {
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case 0x0:
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temp = ZFLAG;
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break;
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case 0x1: // NE
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temp = !ZFLAG;
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break;
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case 0x2: // CS
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temp = CFLAG;
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break;
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case 0x3: // CC
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temp = !CFLAG;
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break;
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case 0x4: // MI
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temp = NFLAG;
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break;
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case 0x5: // PL
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temp = !NFLAG;
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break;
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case 0x6: // VS
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temp = VFLAG;
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break;
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case 0x7: // VC
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temp = !VFLAG;
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break;
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case 0x8: // HI
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temp = (CFLAG && !ZFLAG);
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|
break;
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case 0x9: // LS
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temp = (!CFLAG || ZFLAG);
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|
break;
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case 0xa: // GE
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temp = ((!NFLAG && !VFLAG) || (NFLAG && VFLAG));
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break;
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case 0xb: // LT
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temp = ((NFLAG && !VFLAG) || (!NFLAG && VFLAG));
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break;
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case 0xc: // GT
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temp = ((!NFLAG && !VFLAG && !ZFLAG) || (NFLAG && VFLAG && !ZFLAG));
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break;
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case 0xd: // LE
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temp = ((NFLAG && !VFLAG) || (!NFLAG && VFLAG)) || ZFLAG;
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break;
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case 0xe: // AL
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temp = 1;
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break;
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case 0xf:
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temp = 1;
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break;
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}
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return temp;
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}
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static unsigned int DPO(Immediate)(ARMul_State* cpu, unsigned int sht_oper) {
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static unsigned int DPO(Immediate)(ARMul_State* cpu, unsigned int sht_oper) {
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unsigned int immed_8 = BITS(sht_oper, 0, 7);
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unsigned int immed_8 = BITS(sht_oper, 0, 7);
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||||||
unsigned int rotate_imm = BITS(sht_oper, 8, 11);
|
unsigned int rotate_imm = BITS(sht_oper, 8, 11);
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||||||
@ -230,8 +291,6 @@ struct ldst_inst {
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};
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};
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||||||
#define DEBUG_MSG LOG_DEBUG(Core_ARM11, "inst is %x", inst); CITRA_IGNORE_EXIT(0)
|
#define DEBUG_MSG LOG_DEBUG(Core_ARM11, "inst is %x", inst); CITRA_IGNORE_EXIT(0)
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||||||
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int CondPassed(ARMul_State* cpu, unsigned int cond);
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#define LnSWoUB(s) glue(LnSWoUB, s)
|
#define LnSWoUB(s) glue(LnSWoUB, s)
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||||||
#define MLnS(s) glue(MLnS, s)
|
#define MLnS(s) glue(MLnS, s)
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||||||
#define LdnStM(s) glue(LdnStM, s)
|
#define LdnStM(s) glue(LdnStM, s)
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||||||
@ -1108,9 +1167,9 @@ struct pkh_inst {
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|||||||
typedef arm_inst * ARM_INST_PTR;
|
typedef arm_inst * ARM_INST_PTR;
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||||||
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||||||
#define CACHE_BUFFER_SIZE (64 * 1024 * 2000)
|
#define CACHE_BUFFER_SIZE (64 * 1024 * 2000)
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||||||
char inst_buf[CACHE_BUFFER_SIZE];
|
static char inst_buf[CACHE_BUFFER_SIZE];
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||||||
int top = 0;
|
static int top = 0;
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||||||
inline void *AllocBuffer(unsigned int size) {
|
static inline void *AllocBuffer(unsigned int size) {
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int start = top;
|
int start = top;
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||||||
top += size;
|
top += size;
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||||||
if (top > CACHE_BUFFER_SIZE) {
|
if (top > CACHE_BUFFER_SIZE) {
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||||||
@ -1120,67 +1179,6 @@ inline void *AllocBuffer(unsigned int size) {
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|||||||
return (void *)&inst_buf[start];
|
return (void *)&inst_buf[start];
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}
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}
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int CondPassed(ARMul_State* cpu, unsigned int cond) {
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#define NFLAG cpu->NFlag
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#define ZFLAG cpu->ZFlag
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#define CFLAG cpu->CFlag
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#define VFLAG cpu->VFlag
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int temp = 0;
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switch (cond) {
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case 0x0:
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temp = ZFLAG;
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break;
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case 0x1: // NE
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temp = !ZFLAG;
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break;
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case 0x6: // VS
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temp = VFLAG;
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break;
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case 0x7: // VC
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temp = !VFLAG;
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break;
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case 0x4: // MI
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temp = NFLAG;
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break;
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case 0x5: // PL
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temp = !NFLAG;
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break;
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case 0x2: // CS
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temp = CFLAG;
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break;
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case 0x3: // CC
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temp = !CFLAG;
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break;
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case 0x8: // HI
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temp = (CFLAG && !ZFLAG);
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break;
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case 0x9: // LS
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temp = (!CFLAG || ZFLAG);
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break;
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case 0xa: // GE
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temp = ((!NFLAG && !VFLAG) || (NFLAG && VFLAG));
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break;
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case 0xb: // LT
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temp = ((NFLAG && !VFLAG) || (!NFLAG && VFLAG));
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||||||
break;
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case 0xc: // GT
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||||||
temp = ((!NFLAG && !VFLAG && !ZFLAG) || (NFLAG && VFLAG && !ZFLAG));
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||||||
break;
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case 0xd: // LE
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temp = ((NFLAG && !VFLAG) || (!NFLAG && VFLAG)) || ZFLAG;
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break;
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case 0xe: // AL
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temp = 1;
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break;
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case 0xf:
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||||||
temp = 1;
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||||||
break;
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}
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||||||
return temp;
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||||||
}
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||||||
enum DECODE_STATUS {
|
enum DECODE_STATUS {
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||||||
DECODE_SUCCESS,
|
DECODE_SUCCESS,
|
||||||
DECODE_FAILURE
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DECODE_FAILURE
|
||||||
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