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Fix read-after-write in SMUAD, SMLAD, SMUSD, SMLSD
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parent
960297e577
commit
3a45eacb16
@ -5527,28 +5527,32 @@ unsigned InterpreterMainLoop(ARMul_State* cpu) {
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// SMUAD and SMLAD
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// SMUAD and SMLAD
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if (BIT(op2, 1) == 0) {
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if (BIT(op2, 1) == 0) {
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RD = (product1 + product2);
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u32 rd_val = (product1 + product2);
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if (inst_cream->Ra != 15) {
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if (inst_cream->Ra != 15) {
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RD += cpu->Reg[inst_cream->Ra];
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rd_val += cpu->Reg[inst_cream->Ra];
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if (ARMul_AddOverflowQ(product1 + product2, cpu->Reg[inst_cream->Ra]))
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if (ARMul_AddOverflowQ(product1 + product2, cpu->Reg[inst_cream->Ra]))
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cpu->Cpsr |= (1 << 27);
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cpu->Cpsr |= (1 << 27);
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}
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}
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RD = rd_val;
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if (ARMul_AddOverflowQ(product1, product2))
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if (ARMul_AddOverflowQ(product1, product2))
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cpu->Cpsr |= (1 << 27);
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cpu->Cpsr |= (1 << 27);
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}
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}
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// SMUSD and SMLSD
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// SMUSD and SMLSD
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else {
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else {
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RD = (product1 - product2);
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u32 rd_val = (product1 - product2);
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if (inst_cream->Ra != 15) {
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if (inst_cream->Ra != 15) {
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RD += cpu->Reg[inst_cream->Ra];
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rd_val += cpu->Reg[inst_cream->Ra];
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if (ARMul_AddOverflowQ(product1 - product2, cpu->Reg[inst_cream->Ra]))
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if (ARMul_AddOverflowQ(product1 - product2, cpu->Reg[inst_cream->Ra]))
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cpu->Cpsr |= (1 << 27);
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cpu->Cpsr |= (1 << 27);
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}
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}
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RD = rd_val;
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}
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}
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}
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}
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Reference in New Issue
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